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基于BCH糾錯算法的編解碼器設(shè)計與實現(xiàn)

     

摘要

隨著NAND Flash存儲單元的快速發(fā)展,存儲密度增加使得器件的出錯概率增加,為此提出了一種優(yōu)化的BCH編解碼器結(jié)構(gòu),編碼和解碼過程每個時鐘周期可以并行處理16位數(shù)據(jù),其中譯碼電路中的伴隨式模塊、錯誤位置多項式模塊與錢氏(Chien)搜索模塊采取三級流水線結(jié)構(gòu),糾錯和檢錯階段可以同時進行,有效地提高數(shù)據(jù)的處理速度和糾錯速度。在完成電路的RTL設(shè)計后利用VCS工具完成了電路的仿真驗證,結(jié)果表明在傳輸8 192 bit數(shù)據(jù)生成672校檢因子情況下實現(xiàn)了48位糾錯,工作頻率最高支持200 MHz。

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